?產(chǎn)品介紹：

功能 計(jì)數(shù)器
位 （#） 4
技術(shù)家族 CD4000型
電源電壓 （min） （V） 3
電源電壓（最大值） （V） 18
輸入類型 標(biāo)準(zhǔn)CMOS
輸出類型 推挽式的
特征 平衡輸出，正輸入鉗位二極管，標(biāo)準(zhǔn)速度 （tpd > 50ns）
工作溫度范圍 （°C） -55 到 125

CD4017B 和 CD4022B 是 5 級(jí)和 4 級(jí) Johnson 計(jì)數(shù)器，分別具有 10 個(gè)和 8 個(gè)解碼輸出。輸入包括一個(gè) CLOCK、一個(gè) RESET 和一個(gè) CLOCK INHIBIT 信號(hào)。CLOCK輸入電路中的施密特觸發(fā)器動(dòng)作提供脈沖整形，允許無限的時(shí)鐘輸入脈沖上升和下降時(shí)間。

如果 CLOCK INHIBIT 信號(hào)低電平，則這些計(jì)數(shù)器在正時(shí)鐘信號(hào)轉(zhuǎn)換時(shí)提前一個(gè)計(jì)數(shù)。當(dāng) CLOCK INHIBIT siganl 為高電平時(shí)，通過時(shí)鐘線的反推進(jìn)受到抑制。高 RESET 信號(hào)將計(jì)數(shù)器清除至零計(jì)數(shù)。使用 Johnson 計(jì)數(shù)器配置可實(shí)現(xiàn)高速操作、2 輸入解碼門控和無尖峰解碼輸出。提供防抱死門控，從而確保正確的計(jì)數(shù)順序。解碼后的輸出通常為低電平，僅在各自的解碼時(shí)隙變?yōu)楦唠娖?。每個(gè)解碼輸出在一個(gè)完整的時(shí)鐘周期內(nèi)保持高電平。CARRY OUT信號(hào)在CD4017B中每10個(gè)時(shí)鐘輸入周期或CD4022B中每8個(gè)時(shí)鐘輸入周期完成一個(gè)周期，并用于在多器件計(jì)數(shù)鏈中對(duì)后續(xù)器件進(jìn)行紋波時(shí)鐘。

CD4017B 型和 CD4022B 型采用 16 引腳密封雙列直插陶瓷封裝（F3A 后綴）、16 引腳雙列直插式塑料封裝（E 后綴）、16 引腳小外形封裝（NSR 后綴）和 16 引腳薄型收縮小外形封裝（PW 和 PWR 后綴）。CD4017B 類型還采用 16 引腳小型封裝（M 和 M96 后綴）

特征：
全靜態(tài)操作
中速運(yùn)行…10 MHz（典型值），VDD型= 10 伏
標(biāo)準(zhǔn)化、對(duì)稱的輸出特性
100% 經(jīng)過 20 V 靜態(tài)電流測(cè)試
5V、10V 和 15V 參數(shù)額定值
符合 JEDEC 暫行標(biāo)準(zhǔn) No. 13B“’B’ 系列 CMOS 器件描述的標(biāo)準(zhǔn)規(guī)范”的所有要求
應(yīng)用：
十進(jìn)制計(jì)數(shù)器/十進(jìn)制解碼顯示 （CD4017B）
二進(jìn)制計(jì)數(shù)器/解碼器
頻率劃分
計(jì)數(shù)器控制/定時(shí)器
Divde-by-N 計(jì)數(shù)

? 英語介紹:

Function counter
Bit (#) 4
Technology family CD4000 type
Power supply voltage (min) (V) 3
Supply voltage (Max.) (V) 18
Input type Standard CMOS
Output type push-pull
Features Balanced output, positive input clamp diode, standard speed (tpd > 50ns)
Operating temperature range (°C) -55 to 125

The CD4017B and CD4022B are 5-level and 4-level Johnson counters with 10 and 8 decoded outputs, respectively. The input includes a CLOCK, a RESET, and a CLOCK INHIBIT signal. The Schmidt trigger action in the CLOCK input circuit provides pulse shaping, allowing unlimited clock input pulse rise and fall times.

If the CLOCK INHIBIT signal is low, these counters are one count ahead when the positive clock signal is converted. When the CLOCK INHIBIT siganl is high voltage, the counter-propulsion through the clock line is inhibited. The high RESET signal clears the counter to zero count. The Johnson counter configuration enables high-speed operation, 2-input decoding gating, and spike-free decoding output. Provides anti-lock gating to ensure correct counting sequence. The decoded output is usually low and only becomes high at the respective decoding time slot. Each decoded output remains high for a full clock cycle. The CARRY OUT signal completes one cycle every 10 clock input cycles in the CD4017B or every 8 clock input cycles in the CD4022B and is used to ripple clock subsequent devices in a multi-device counting chain.

Models CD4017B and CD4022B are available in 16-pin sealed dual-in-line ceramic packages (F3A suffix), 16-pin dual-in-line plastic packages (E suffix), 16-pin small form factor packages (NSR suffix), and 16-pin thin shrink form factor packages (PW and PWR suffix). The CD4017B type also comes in a 16-pin compact package (M and M96 suffixes)

Features:
Fully static operation
Medium speed operation… 10 MHz (typical value), VDD type = 10 volts
Standardized, symmetrical output characteristics
100% tested with 20 V static current
5V, 10V and 15V parameter ratings
Meets all requirements of JEDEC Interim Standard No. 13B “Standard Specification for Description of ‘B’ Series CMOS Devices”
Applications:
Decimal counter/Decimal decoding display (CD4017B)
Binary counter/decoder
Frequency division
Counter control/timer
Divde-by-N counts

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大量供應(yīng)原裝進(jìn)口DCS系統(tǒng)配件，PLC系統(tǒng)配件。

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?常見問題和聯(lián)系方式：?

問：您是貿(mào)易公司還是制造商？

答： 我們是一家貿(mào)易公司。

問： 你們的交貨時(shí)間是多久？

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問： 貴公司是否提供樣品？它是免費(fèi)的還是額外收費(fèi)的？

答： 這取決于您需要的商品和您訂購(gòu)的數(shù)量。

問： 你們的付款條件是什么？

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